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岗位 / 公司
薪资
地点
ASIC设计工程师（DPU方向）-Data
字节跳动
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经验不限
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学历不限
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1 年前
社招
需本科及以上学历，精通Verilog硬件设计语言，有网络芯片开发流片经验，熟悉计算机体系结构及总线接口协议
Verilog
RTL
ASIC
PCIe
面议
北京
官网投递
SOC前端设计工程师（SOC+IP）-Data（北京）
字节跳动
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经验不限
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学历不限
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6 年前
社招
需电子/微电子相关专业本科5年或硕士3年以上SOC前端设计经验，精通Verilog/SystemVerilog
Verilog
SystemVerilog
ARMV8
Synopsys
面议
北京
官网投递
