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数字设计主管工程师(BMS)
兆易创新
·
经验不限
·
学历不限
·
昨天
社招
需微电子或电子类专业研究生学历，5年以上数字设计经验，熟悉Verilog、UVM及Synopsys工具链
Verilog
system verilog
Python
uvm
面议
成都
官网投递
平头哥-边缘AI芯片设计实现专家/高级专家-上海
平头哥
·
3年以上
·
本科
·
3 天前
社招
需5年以上芯片设计实现经验，精通综合工具(DC/PT等)，熟悉低功耗实现和PPA优化，电子工程或计算机相关专业本科。
DC
formality
PT
PTPX
面议
上海
官网投递
